Der Hintergrundband gibt dem Entwurfsspezialisten Gelegenheit, den großen Entwurf des RISC-Prozessors TOOBSIE an beliebiger Stelle "bis ins letzte Bit" zu untersuchen oder den Entwurf als Ganzes für eigene Experimente oder die Entwicklung eigener CAD-Werkzeuge zu übernehmen. Hierzu gehören neben einer detaillierten Dokumentation des Befehlssatzes und den vollständigen ablauffähigen VERILOG-Modellen auch die umfangreiche graphische Gatternetzliste. Gerade die vollständige Offenlegung aller Einzelheiten dürfte das Werk von anderen Büchern, aber auch von anderen großen kommerziellen Entwürfen unterscheiden.



Autorentext

Prof. Dr. Ulrich Golze ist Professor für den Entwurf integrierter Schaltungen an der TU Braunschweig.



Inhalt
1 Einleitung.- 2 Die Befehle im einzelnen.- 3 Das Interpreter-Modell als VERILOG-Code.- 4 Das Grobstrukturmodell.- 4.1 Die Pipeline-Control-Unit PCU.- 4.2 Die Bus-Control-Unit BCU.- 4.3 Der Branch-Target-Cache BTC.- 4.4 Die Behandlung von Interrupts.- 4.5 Die Systemumgebung.- 4.6 Experimente mit dem Grobstrukturmodell.- 4.7 Quellcode des Grobstrukturmodells.- 5 Das Gattermodell.- 5.1 Hierarchische Gliederung.- 5.2 Der Prozessor-Chip (Ebene 1).- 5.3 Die Pipeline-Stufen (Ebene 2).- 5.4 Die Caches und andere Untermodule (Ebene 3).- 5.5 Schematics.- Literatur und Index.
Titel
Der RISC-Prozessor TOOBSIE
Untertitel
Hintergrundband zum Buch VLSI-Entwurf eines RISC-Prozessors für den Entwurfsspezialisten
EAN
9783322895516
Format
E-Book (pdf)
Veröffentlichung
08.03.2013
Digitaler Kopierschutz
Wasserzeichen
Anzahl Seiten
431
Auflage
1995
Lesemotiv